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室内LED灯具保护电路设计的要求与注意事灯具项

发布于:2018-12-23 20:19 作者:秒速赛车 来源:未知 人气:
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室内LED灯具保护电路设计的要求与注意事灯具项最初设计的室内LED灯具,设计人员面临着各种各样的技术挑战。这些瓶颈包括交直流逆变电路的功率转换、热功耗考虑/散热、当前灯泡尺

  室内LED灯具保护电路设计的要求与注意事灯具项最初设计的室内LED灯具,设计人员面临着各种各样的技术挑战。这些瓶颈包括交直流逆变电路的功率转换、热功耗考虑/散热、当前灯泡尺寸的物理空间限制、瞬态电气脉冲,这些都是除了驱动LED发光的基本电路设计之外的技术瓶颈。

  这些挑战中最重要的一个是针对LED颗粒以及其上游电路中的所有主被动元件提供瞬态脉冲保护。这些瞬态脉冲通常是交流输入电路中的雷击感应浪涌。这些浪涌意味着LED灯具需要过流及过压保护。

  对LED灯具的功能及高亮度的需求增长意味着驱动电路板上的器件越来越多。大功率LED驱动形成高亮度输出,同时会产生大量的热功耗,这意味着需要更大的散热片。因为LED灯具旨在与现有的白炽灯和CFL灯具(如通常用于家用照明的主流A19灯具)在封装形式上兼容,都包含有一条交流/直流变换的电源驱动电路,因此可以在标准灯具插座上使用(图1)。

  由于灯具内的元件和(或者)电路故障引起的短路或过载现象,都可能导致直接连接在交流电源中的任何元器件损坏。此外,雷击感应浪涌或开关机脉冲(灯具外部产生)产生的尖峰电压或振铃波会对灯具内部的元件造成压力并最终造成元件损坏。

  一只LED灯具包括图2中所示的基本电路模块,其中从右到左依次为:

  多晶片及单晶片LED颗粒采用串联连接配置,称之为LED灯串。多个串联LED灯串并联并由同一个电源驱动。

  具有相应保护电路的LED灯串驱动电路中,包括串联在回路中的针对过流保护(OCP)的正温度系数(PTC)电阻和并联在回路中的用于过压保护(OVP)的 TVS二极管。

  DC-DC电源转换电路中,包括在输入端上针对下游元件的次级过压保护的并联TVS 二极管。

  交流整流电路中,包括在输出端上针对下游元件次级过流保护的串联高压直流保险丝。

  交流输入电路中,由火线(L)上的串联交流保险丝和火线(L)—零线(N)间并联的MOV组成。

  交流输入电路中,交流保险丝是灯具的主要过电流保护器件。如果针对所有必要的设计参数进行正确选择,当由于感应瞬变和短路/过载所导致的过度电性应力(EOS)产生时,这种保险丝通过将所有电路与交流输入安全地断开,充分保护所有下游元件免受损坏。

  鉴于与LED灯具设计相关的空间限制,针对交流输入选择一个紧凑型的交流保险丝是至关重要的。保险丝的功能是在电流过载情况下可靠且可预测的熔断来为元件和完整的电路提供保护。

  换句话说,保险丝是电路中的薄弱环节。串联在交流线路输入端的交流保险丝能提供短路和过载保护。如今,交流保险丝具有广泛的额定电流与额定电压范围,可应用于最小的结构中。还有一系列其他的关键保险丝参数和可表面贴装的设计供使用,使设计工程师能够选择出满足所有应用要求的保险丝。

  具有足够的I2T额定值的交流保险丝是通过按照IEEEC.62.41标准要求的能源之星振铃测试所必需的器件。标称的热熔值I2T(单位:安培平方秒,A2sec)规定了熔断保险丝熔丝所需的能量大小。

  通常,根据标称热熔值I2T选择的保险丝适用于保险丝必须承受较短持续时间的大电流脉冲的应用。LED照明应用的浪涌抗扰度测试需要符合8×20μs的组合波形。即使其标称热熔值I2T超过了波形能量的热熔值,不同的保险丝结构对浪涌事件也不会有相同的反应方式。例如,电力浪涌脉冲产生热循环,可以使保险丝产生机械疲劳从而缩短其寿命。

  LED照明灯具的交流输入端的压敏电阻(MOV)是初级过压保护器件。如果针对所有必要的设计参数进行正确选择,它将可以通过钳制短时电压脉冲,保护所有下游元件免受因感应瞬变和环波效应所导致的电应力(EOS)的损坏。

  当由于感应瞬变和短时嵌位电压脉冲产生的振铃导致的过度电性应力(EOS)发生时,MOV保护所有下游元件免受损坏。MOV提供了一种最大程度降低瞬变能量的高性价比的方案,防止其可能会进入下游元件。正确的 MOV器件选型要以诸多电气参数为基础,包括额定电压、峰值脉冲电流、能量等级、圆盘尺寸和引脚方式。

  LED照明灯具的设计人员需要考虑各种重要的问题,针对交流输入电路选择合适的交流保险丝:

  第一步是找到关于应用的一些技术问题的答案。在过去,理解和回答这些技术问题,然后通过元件规格书搜索针对某种应用选择合适的保险丝,这是一项非常令人困惑和耗时的工作。这些问题包括灯具的正常工作电流、工作电压、环境温度、过载电流水平和保险丝熔断需要的时间、最大允许故障电流以及脉冲、浪涌电流、瞬间热插拔脉冲、启动电流和电路瞬变等。

  Littelfuse还提供一种以《保险丝选型指南》为基础的强大的在线选型工具 - iDesign保险丝选型指南。它旨在帮助电路设计人员为它们的项目确定最佳的电子保险丝。iDesign工具提供了一种快速、直观的方法来确定适合应用的最佳元件,找出元件的说明文档,并订购元件样品以进行原型设计。它通过保险丝选型步骤,根据所提供的输入信息快速缩小可选范围,帮助设计人员选择到合适的保险丝。

  在初始设计时,知道灯具将要出售的市场是至关重要的。根据灯具是否在美国、北美的其他地方,欧洲、亚洲或其他区域使用,设计和测试必须要满足不同的标准。

  确定可能影响可使用的保险丝的尺寸限制。保险丝可以使用多种方法进行封装,但表面贴装设计是LED照明应用中最常见的封装形式。幸运的是,对于电路设计人员来说,现在可以使用更小尺寸的保险丝来保护交流输入,其中一些的尺寸只有以前可用的最小保险丝的一半。

  电流流过保险丝产生的温度随着环境温度的变化而增加或减少。请注意,保险丝的“环境温度”并非正如其名,等同于“室温”。相反,环境温度是保险丝周围空气的温度,通常远高于室温,因为保险丝可能会被封装在(例如在保险丝座中)或安装在LED板的发热部件附近。对于25摄氏度的环境温度,通常建议保险丝的工作电流不超过额定电流的75%。保险丝本质上是温度敏感的器件,所以当保险丝100%满载到额定值时,即使很小的温度变化也可能会极大地影响保险丝的预期寿命。

  确定应用所需的分断能力。分断能力也可能被称为熔断额定值或短路额定值(I2T值)。这是保险丝在额定电压条件下可以安全熔断的最大许可电流。在故障或短路状态下,保险丝可能承受一个远高于正常工作电流的瞬间过载电流。断开意味着完好无损(无爆炸或本体破裂)并切断电路。

  确保在生产之前有足够的时间进行全面的应用测试和验证。如果初始设计没有通过其中任何一项测试,请确保在计划中有足够的余地来修改设计并重新测试。

  最后,设计人员必须将保险丝与下游过压保护器件和LED灯串驱动电路配合好。在LED灯具设计过程之初,必须考虑到瞬态抑制。保险丝的选型必须要能满足规格定义的能量冲击,避免LED灯串驱动电路受到不利影响。交流输入电路上的保险丝和MOV,如果选型合适,当出现瞬态脉冲时,无需保险丝断开就能实现过压钳位保护、安全地保护下游电路,同时最大程度降低了对LED灯串驱动电路(包括LED灯串本身)的损伤。

  然而,也有特定的LED照明灯具工作电路无法承受瞬态脉冲冲击。在这些情况下,正如在前面关于DC-DC转换器模块的内容中所指出的,添加一个用于过压保护的辅助次级TVS二极管是一种经过验证方案,可进一步钳制MOV的“残压”能量。在最极端的情况下,甚至还有一个额外的过流保护器件(如图2的中部所示,交流整流模块中的高压直流保险丝)和LED灯串中的过流保护器件(与LED灯串串联的PTC)、过压保护(与LED灯串并联的TVS二极管)以及LED开路保护(与LED晶粒并联的单个PLED),以提供更强劲的电路保护。

  瞬态电压抑制必须是初始设计过程的一部分;所选择的的器件必须能够减少瞬态脉冲能量,抑制住脉冲电压,从而使驱动电路不受影响。

  TVS二极管是最常用的一种抑制器件。TVS二极管专门设计用于保护电子电路,防止瞬态过电压。作为一种硅半导体雪崩器件,它既有单向也有双向。在单向TVS,特定的钳位特性只在一个方向上表现出来,在另一个方向上显示出的是类似于传统的整流器二极管的正向导通电压(VF)特性。LED照明电源(驱动器)通常在其电路中一个或多个位置上需要安装TVS二极管。

  瞬态脉冲的破坏潜力是由其峰值电压、持续电流和脉冲宽度所决定的。当用于保护诸如驱动IC和LED晶粒等敏感元件时,瞬态抑制器的响应时间极为重要。如果瞬态抑制器响应速度慢,当系统上出现了快速上升的瞬态尖峰时,在抑制器开始动作前,通过被保护负载的尖峰电压就已上升并起到破环作用

  反向截止电压(VR)。其中最重要的参数是VR,其必须等于或大于被保护电路(或电路的一部分)的峰值工作电压。确保TVS在正常驱动电压下不会动作。

  峰值脉冲电流(IPP)。IPP是TVS所能承受的最大安全脉冲电流,通常以诸如10×1000μs的指数波形为参照表示。Ipp仅表示瞬态峰值电压除以源阻抗的值。

  最大钳位电压(VC)。VC是基于参照的指数波形,在脉冲峰值电流(IPP)流过TVS 器件时,TVS 两端出现的峰值电压。

  TVS二极管中的故障机制是短路。灯具因此,如果TVS二极管因瞬态脉冲而出现故障,其所在的电路依然会受到保护。

  在LED 灯具设计初期阶段就有完善的电路保护,并投入所需的时间和资源的设计人员将会收获成功的产品和更好的用户体验。由于交流保险丝、交流MOV和TVS二极管等元件的最新进展,到新一代设计人员诞生之前,下一代LED灯具就可能到来。

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  = 0.8 V)或GTLP(V TT = 1.5 V且V REF = 1 V)信号电平。有关在FB + /BTL应用中使用GTLP器件的信息,请参阅TI应用报告,德州仪器GTLP常见问题解答,文献编号SCEA019和BTL应用中的 GTLP ,文献编号SCEA017。 通常,B端口工...

  SN74FB1653 具有缓冲时钟线 位 LVTTL/BTL 通用存储收发器

  SN74FB1653包含一个带缓冲时钟的8位和9位收发器。时钟和收发器设计用于在LVTTL和BTL环境之间转换信号。该器件专为与IEEE Std 1194.1-1991(BTL)兼容而设计。 A端口工作在LVTTL信号电平。当A端口输出使能(OEA)为高电平时,A输出反映B \端口数据的反转。当OEA为低电平或V CC (5 V)通常小于2.5 V时,A输出处于高阻态。 B端口工作于BTL信号电平。开集极B \端口指定吸收100 mA。为B \输出提供两个输出使能(OEB和OEB)\。当OEB为低电平时,OEB \为高电平,或者V CC (5 V)通常小于2.5 V,B端口关闭。 时钟选择( 2SEL1和2SEL2)输入用于配置TTL到BTL时钟路径和延迟(参见 MUX-MODE DELAY 表)。 BIAS V CC当未连接V CC (5 V)时,在BTL输出上建立1.62 V和2.1 V之间的电压。 BG V CC 和BG GND是偏置发生器的电源输入。 V REF 是内部产生的电压源。建议将V REF 与0.1μF电容去耦。 当此设备从AI到A0以大于50的频率运行时,应使用增强的散热技术频率大于100 MHz时,或从AI到B \或B \到A0。 特性 与IE...

  GTL2010提供10个NMOS传输晶体管(Sn和Dn),共栅极(G REF )和参考晶体管( S REF 和D REF )。开关的低导通电阻允许以最小的传播延迟进行连接。由于不需要方向控制引脚,该器件允许双向电压转换任何电压(1 V至5 V)至任何电压(1 V至5 V)。 当Sn或Dn端口为低电平时,钳位处于ON状态,Sn和Dn端口之间存在低电阻连接。假设Dn端口上的电压较高,当Dn端口为高电平时,Sn端口上的电压限制为参考晶体管设置的电压(S REF )。当Sn端口为高电平时,通过上拉电阻将Dn端口拉至V CC 。 GTL2010中的所有晶体管都具有相同的电气特性,在电压或传播延迟方面,从一个输出到另一个输出的偏差最小。这提供了优于分立晶体管电压转换解决方案的匹配,其中晶体管的制造不对称。在所有晶体管相同的情况下,参考晶体管(S REF /D REF )可以位于其他十个匹配的Sn /Dn晶体管中的任何一个上,从而实现更简单的电路板布局。具有集成ESD电路的转换器晶体管可提供出色的ESD保护。 特性 提供无方向控制的双向电压转换 允许电压电平从1 V升至5 V 提供与GTL,GTL +,LVTTL /TTL和5-V CM...

  SN74FB2040是一款8位收发器,设计用于在TTL和背板收发器逻辑(BTL)环境之间转换信号。 B \ port以BTL信号电平工作。开集极B \端口指定吸收100 mA。为B \输出提供两个输出使能(OEB和OEB \)。当OEB为高电平且OEB \为低电平时,B \ n端口有效并反映A输入引脚上存在的数据的反转。当OEB为低电平时,OEB \为高电平,或者V CC 小于2.1 V,B \ n端口关闭。 A端口工作在TTL信号电平并有独立的输入和输出引脚。当A端口输出使能(OEA)为高电平时,A输出反映B \端口数据的反转。当OEA为低电平或V CC 小于2.1 V时,A输出处于高阻态。 引脚TMS,TCK,TDI和TDO均为非功能性的,即不适用于IEEE Std 1149.1(JTAG)测试总线。 TMS和TCK未连接,TDI短接至TDO。 BIAS V CC 在V CC时在BTL输出上建立1.62 V至2.1 V之间的电压未连接。 特性 与IEEE Std 1194.1-1991(BTL)兼容 TTL A端口,背板收发器逻辑(BTL)B \端口 开路集电极B \ - 端口输出接收器100 mA 上电和断电期间的高阻状态 BIAS V CC

  SN74GTL16612 18 位 LVTTL 至 GTL/GTL+ 通用总线位UBT ??提供LVTTL到GTL /GTL +和GTL /GTL +到LVTTL信号电平转换的收发器。它们结合了D型触发器和D型锁存器,可实现与16601功能相同的透明,锁存,时钟和时钟使能模式的数据传输。这些器件提供以LVTTL逻辑电平工作的卡与以GTL /GTL +信号电平工作的背板之间的接口。高速操作是减少输出摆幅(

  SN74FB2033A是一款8位收发器,在TTL电平A端口上具有分离输入(AI)和输出(AO)总线。通用I /O,集电极开路B \ n端口工作在背板收发器逻辑(BTL)信号电平。 每个方向的数据流逻辑元素由两个模式输入(B-to-A的IMODE1和IMODE0,A-to-B的OMODE1和OMODE0)配置为缓冲区,D-类型触发器或D型锁存器。在缓冲模式下配置时,反向输入数据出现在输出端口。在触发器模式下,数据存储在相应时钟输入(CLKAB /LEAB或CLKBA /LEBA)的上升沿。在锁存模式下,时钟输入用作高电平有效透明锁存器使能。 无论选择何种逻辑元素,B-to-A方向的数据流都由LOOPBACK输入进一步控制。当LOOPBACK为低电平时,B \ -port数据是B-to-A输入。当LOOPBACK为高电平时,所选A-to-B逻辑元件的输出(反转之前)是B-to-A输入。 AO端口启用/-disable控件由OEA提供。当OEA为低电平或V CC 小于2.5 V时,AO端口处于高阻态。当OEA为高电平时,AO端口处于活动状态(逻辑电平为高或低)。 B \ port由OEB和OEB \控制。如果OEB为低电平,OEB \为高电平,或者V CC 小...

  SN74FB2031 9 位 TTL/BTL 地址/数据收发器

  SN74FB2031是一款9位收发器,设计用于在TTL和背板收发器逻辑(BTL)环境之间转换信号。该器件专为与IEEE Std 1194.1-1991兼容而设计。 B \端口以BTL信号电平工作。开集极B \端口指定吸收100 mA。为B \输出提供两个输出使能(OEB和OEB \)。当OEB为低电平时,OEB \为高电平,或者V CC 小于2.1 V,B \ n端口关闭。 A端口以TTL信号电平工作。当A端口输出使能(OEA)为高电平时,A输出反映B \端口数据的反转。当OEA为低电平或V CC 小于2.1 V时,A输出处于高阻态。 针对四线(JTAG)测试总线分配引脚,尽管目前还没有计划发布JTAG特性版本。 TMS和TCK未连接,TDI与TDO短路。 当V CC 未连接时,BIAS V CC 在BTL输出上建立1.62 V和2.1 V之间的电压。 BG V CC 和BG GND是偏置发生器的电源输入。 特性 与IEEE Std 1194.1-1991(BTL)兼容 TTL A端口,背板收发器逻辑(BTL)B \端口 开路集电极B \ - 端口输出接收器100 mA 上电和断电期间的高阻状态 BIAS V CC

  SN74FB1650 18 位 TTL/BTL 通用存储收发器

  SN74FB1650包含两个9位收发器,用于在TTL和背板收发器逻辑(BTL)环境之间转换信号。该器件专为与IEEE Std 1194.1-1991兼容而设计。 B \ n端口工作在BTL信号电平。开集极B \端口指定吸收100 mA。为B \输出提供两个输出使能(OEB和OEB \)。当OEB为低电平时,OEB \为高电平,或者V CC 小于2.1 V,B \ n端口关闭。 A端口工作在TTL信号电平。当A端口输出使能(OEA)为高电平时,A输出反映B \端口数据的反转。当OEA为低电平或V CC 小于2.1 V时,A输出处于高阻态。 BIAS V CC 建立当未连接V CC 时,BTL输出上的电压介于1.62 V和2.1 V之间。 BG V CC 和BG GND是电源输入用于偏置发生器。 特性 与IEEE Std 1194.1-1991(BTL)兼容 TTL A端口,背板收发器逻辑(BTL)B \端口 开路集电极B \ - 端口输出接收器100 mA BIAS V CC 最大限度地减少实时插入或拔出期间的信号失真 上电和断电期间的高阻抗状态 B \ - 端口偏置网络预先连接器和PC跟踪到BTL高电平电压 TTL输入结构包含有效在线终止时紧急援助 参数 与其它产品相...

  SN10KHT5574 具有 D 类边沿触发器和三态输出的八路 ECL 至 TTL 转换器

  这个八进制ECL到TTL转换器旨在提供10KH ECL信号环境和TTL信号环境之间的有效转换。该器件专门用于提高ECL-to-TTL CPU /总线导向功能的性能和密度,如存储器地址驱动器,时钟驱动器和面向总线的接收器和发送器。 八SN10KHT5574的触发器是边沿触发的D型触发器。在时钟正跳变时,Q输出设置为在D输入端设置的逻辑电平。 缓冲输出使能输入( OE ”可用于将8个输出置于正常逻辑状态(高或低逻辑电平)或高阻态。在高阻抗状态下,输出既不会加载也不会显着驱动总线。高阻抗第三状态和增加的驱动提供了驱动总线的能力,而无需接口或上拉组件。 输出使能输入 OE

  不会影响触发器的内部操作。输出关闭时,可以保留旧数据或输入新数据。 SN10KHT5574的特点是在0°C至75°C的温度范围内工作。 特性 10KH兼容 ECL时钟和TTL控制输入 流通式架构优化PCB布局 中心引脚V CC ,V EE 和GND配置最大限度地降低高速开关噪声 封装选项包括“小”概述“包装和标准塑料DIP 参数 与其它产品相比 GTL/TTL/BTL/ECL 收发器/转换器   Technology Family VCC (Min) (V) ...

  SN74GTLP21395 具有独立 LVTTL 端口、Fdbk 路径和可选择极性的双路 1 位 LVTTL/GTLP 可调节边沿速率总线线总线收发器,提供LVTTL到GTLP和GTLP到LVTTL信号 - 应用程序的级别转换,例如主时钟和辅助时钟,需要单独的输出启用和真/补控制。该器件允许透明和反向透明的数据传输模式,具有独立的LVTTL输入和LVTTL输出引脚,为控制和诊断监控提供反馈路径。该器件提供以LVTTL逻辑电平工作的卡与工作在GTLP信号电平的背板之间的高速接口,专为与德州仪器3.3-V 1394背板物理层控制器配合使用而设计。高速(比标准LVTTL或TTL快约三倍)背板操作是GTLP降低输出摆幅( Y输出设计用于吸收高达12 mA的电流,包括等效的26- 电阻器可减少过冲和下冲。 GTLP是德州仪器(TI)衍生的Gunning收发器逻辑(GTL)JEDEC标准JESD 8-3。 SN74GTLP21395的交流规格仅在优选的较高噪声容限GTLP下给出,但用户可以灵活地在GTL上使用该器件(V TT = 1.2 V且V REF

  = 0.8 V)或GTLP(V TT = 1.5 V且V REF = 1 V)信号电平。有关在FB + /BTL应用中使用GTLP器件的信息,请参阅TI应用报告,德州仪器GTLP常见问题解答,...

  SN74GTLP1394 具有独立 LVTTL 端口、反馈路径和可选择极性的 2 位 LVTTL 到 GTLP 可调节边沿速率总线线总线收发器,可提供LVTTL至GTLP和GTLP至LVTTL信号 - 级别翻译。它允许透明和反向透明的数据传输模式,具有独立的LVTTL输入和LVTTL输出引脚,为控制和诊断监控提供反馈路径。该器件提供以LVTTL逻辑电平工作的卡与工作在GTLP信号电平的背板之间的高速接口,专门设计用于与德州仪器1394背板物理层控制器配合使用。高速(比标准LVTTL或TTL快约三倍)背板操作是GTLP降低输出摆幅( = 0.8 V)或GTLP(V TT = 1.5 V且V REF = 1 V)信号电平。 通常情况下,B端口以GTLP信号电平工作。 A端口和控制输入工作在LVTTL逻辑电平,但具有5 V容差,并兼容TTL和5 V CMOS输入。 V REF 是B端口差分输入参考电压。 该器件完全指定用于使用I off 的上电插入应用,上电3 -state和BIAS V CC 。 I off 电路禁用输出,防止在断电时损坏通过器件的电流回流。上电和断电期间,上电三态电路将输出置于高阻态,从而防止驱动器冲突。秒速赛车注册 BIAS V CC 电路对B端口输入/输出连接进行预充电和预处理,防止在插入或拔出卡时干扰背板上的有效数...

  SN74GTL1655 可带电插入 16 位 LVTTL 到 GTL/GTL+ 通用总线 mA),低输出阻抗(12 )16位UBT ??提供LVTTL-to-GTL /GTL +和GTL /GTL + -to-LVTTL信号电平转换的收发器。该器件被划分为两个8位收发器,并结合了D型触发器和D型锁存器,以实现类似于?? 16501功能的透明,锁存和时钟数据传输模式。该器件提供以LVTTL逻辑电平工作的卡与以GTL /GTL +信号电平工作的背板之间的接口。高速操作是减少输出摆幅(

  服务器 基站 有线通信 所有商标均为其各自所有者的财产。 参数 与其它产品相比 GTL/TTL/BTL/ECL 收发器...

  在使用灯具的过程中如果发生异常情况,应立即停止使用,切断电源进行检查维修。

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  灯具的金属部分不能随意使用擦亮粉,灯具背后的灰尘应用掸子或干布擦拭。

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